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Ao se definir em um projeto de um Circuito Integrado de...
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Q699767
Teclas de Atalhos
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Ao se definir em um projeto de um Circuito Integrado de Aplicação Específica (ASIC – “Application Specific Integrated
Circuit”) as interconexões dos sinais de relógio (clock), um dos problemas a ser resolvido é o chamado “clock skew”.
Dentro desse contexto, analise as asserções a seguir e assinale a opção correta:
I - O “clock skew” ocorre devido à diferença de tamanho dos percursos que o sinal de clock percorre antes de alimentar
as células lógicas de um circuito.
II - Na realização das interconexões do sinal de clock de um projeto de um ASIC, podem ser inseridos buffers especiais
controlando o atraso inserido em cada linha da árvore de clock.
A
As duas asserções são verdadeiras, e a segunda é uma solução correta para o problema apresentado na primeira.
B
As duas asserções são verdadeiras, mas a segunda não é uma solução correta para o problema apresentado na primeira.
C
A primeira asserção é uma proposição verdadeira, e a segunda é uma proposição falsa.
D
A primeira asserção é uma proposição falsa, e a segunda é uma proposição verdadeira.
E
Tanto a primeira como a segunda asserções são falsas.