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Segundo Tanenbaum (2013), duas das possibilidades existentes para o ganho de velocidade no chip são o:
paralelismo no nível da compilação e o aumento de memória cache.
multithreading no chip e o paralelismo no nível da instrução.
aumento de memória secundária e a duplicação da MMU (Memory Management Unity).
uso de processadores de 64 bits sem registradores e a ausência de memória cache.
uso de programas compilados em linguagem de alto nível e de co-processadores.


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