Questões de Concurso sobre Arquiteturas clássicas

 
 
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O barramento de entrada/saída de dados de alta velocidade para componentes de performance crítica, como, por exemplo, controladores de vídeo e dispositivos de armazenamento é o barramento


A

do processador.


B

de cache.


C

de memória.


D

I/O padrão.


E

I/O local.

Com base na visão de arquitetura de software 4 + 1, considere.

I. Mostra como os componentes de software são distribuídos entre os processadores. Essa visão é útil para os engenheiros de sistemas que estão planejando uma implantação do sistema.

II. Mostra as abstrações fundamentais do sistema como objetos ou classes de objetos. Nessa visão, deveria ser possível relacionar os requisitos de sistema com as entidades.

III. Mostra as interações ambientais do sistema no tempo de execução. Essa visão é útil para fazer julgamentos sobre características do sistema, tais como desempenho e disponibilidade.

As visões são, correta e respectivamente,


A

física, de processo e lógica.


B

lógica, física e de processo.


C

de processo, lógica e física.


D

física, lógica e de processo.


E

lógica, de processo e física.

Somadores são componentes fundamentais no projeto de sistemas digitais. O somador em cascata, ou carry ripple adder, é um projeto simples, construído com outros dois tipos de componentes: somadores completos e meio somadores. Considerando que cada porta lógica de um somador em cascata de 4 bits tem um atraso de 1 ns, o tempo mínimo necessário para esse componente somar qualquer número de 4 bits é


A
8 ns.

B
7 ns.

C
4 ns.

D
3 ns.

O termo destacado em: “computador de 64 bits”, está se referindo a qual componente de um computador?


A

Memória RAM.


B

BIOS.


C

Processador.


D

Hard Disk.


E

Placa de Rede.

Sobre organização e arquitetura de computadores, analise as seguintes proposições.

1) Por serem externos ao computador, os dispositivos de E/S não podem ser considerados componentes estruturais importantes de um computador.

2) A Unidade de Controle (UC) de uma CPU é responsável pelo controle da operação da CPU. Por conseguinte, ela é responsável pelo controle da operação do próprio computador.

3) A Unidade Lógica e Aritmética (ULA) de uma CPU se responsabiliza pelas funções de processamento de dados do computador, incluindo operações lógicas e aritméticas.

4) A conexão entre a CPU e a memória do computador, por questões de desempenho, não é realizada via barramentos. Barramentos são usados apenas na comunicação entre CPU e periféricos.

Estão corretas, apenas:


A

1 e 2.


B

2 e 3.


C

3 e 4.


D

1 e 3.


E

2 e 4.

O processador, ou a CPU, de um computador é o componente responsável por executar praticamente todas as instruções necessárias para seu funcionamento.


C
Certo

E
Errado

No processador, o dispositivo que é responsável por regular sua frequência de trabalho, pelas operações de cálculos matemáticos e pela execução de programas é o(a)


A

BIOS.


B

Setup.


C

Hertz.


D

clock externo.


E

clock interno.

Sobre Características de Processadores, é correto afirmar:


A

Os modelos Intel Core i7 possuem 4 núcleos expansíveis até 8.


B

A tecnologia de sistema em um chip (System-on-a-chip) impede a escalabilidade de processadores da família AMD Zen.


C

Hyper-Threading é um protocolo disponível em processadores Intel e AMD.


D

Velocidade de clock não é o melhor modo de medir o desempenho de um processador.


E

Todos os processadores da família Intel Core i têm o mesmo tipo de socket.

Rogerio é arquiteto de aplicações de uma grande empresa de produtos de tecnologia, e recebeu como meta, a entrega de uma proposta para alteração da arquitetura dos computadores utilizados para desenvolvimento dos produtos internos. Quanto às arquiteturas CISC, RISC e processadores, relacione as colunas abaixo e assinale a alternativa correta.


I. CISC

1. Apple

2. Intel


II. RISC

3. IBM

4. SUN



A

II-2, I-1, I-3, I-4


B

I-2, II-1, II-3, II-4


C

II-2, II-1, II-3, I-4


D

I-2, I-3, I-4, II-1

Sobre Hardware, leia o texto. A arquitetura de computadores de John von Neumann é composta basicamente por 3 (três) sistemas de hardware:


1- ________I________, que é composta pela ________II________ e ________III________, além de ________IV________;

2- ________V________, responsável por armazenar os programas cujas instruções serão executadas pela ________I________;

3- ________VI________, que permite basicamente o fornecimento de dados para o computador e exibe/armazena os resultados do processamento.


Assinale a alternativa que preenche corretamente as lacunas.


A

I-Unidade Central de Processamento (CPU), II-Unidade Lógica e Aritmética (ULA), III-Unidade de Controle (UC), IV-Registradores, V-Memória Principal, VI-Sistema de Entrada e Saída.


B

I-Memória Principal, II-Unidade de Controle (UC), III-Unidade Lógica e Aritmética (ULA), IVRegistradores, V-Unidade Central de Processamento (CPU), VI-Sistema de Entrada e Saída.


C

I-Unidade Central de Processamento (CPU), II-Memória Principal, III-Unidade de Controle (UC), IVSistema de Entrada e Saída, V-Unidade Lógica e Aritmética (ULA), VI-Registradores.


D

I-Unidade de Controle (UC), II-Unidade Lógica e Aritmética (ULA), III- Unidade Central de Processamento (CPU), IV-Sistema de Entrada e Saída, V-Memória Principal, VI-Registradores.

A solução tradicional para armazenar grandes quantidades de dados é uma hierarquia de memória. Sobre essa hierarquia de memória, assinale a alternativa correta.


A

No topo, tem-se a memória cache e os registradores não fazem parte dessa hierarquia de memória.


B

A memória RAM, ou memória principal, está no topo dessa hierarquia de memória.


C

As memórias de massa, ou discos rígidos, ocupam o topo da hierarquia, visto que podem armazenar uma quantidade maior de dados e possuem uma velocidade maior de acesso, uma vez que a maioria dos discos atinge 7200 rpm.


D

No topo, estão os registradores de CPU, que podem ser acessados à velocidade total da CPU; em seguida, tem-se a memória cache.


E

A hierarquia de memória possui, em seu topo, a memória ROM, seguida dos registradores e, em sequência, as memórias de massa ou armazenamento.

O scheduling da CPU lida com a escolha de qual processo, ou thread, da fila de prontos deve ser alocado a seguir. Existem vários algoritmos com essa função, sendo que um é comprovadamente ótimo, no quesito de minimizar o tempo médio de espera para determinado conjunto de processos. Esse algoritmo ótimo é scheduling


A

“primeiro-a-chegar, primeiro-a-ser-atendido” (FCFS – First-Come First-Served).


B

trabalho mais curto primeiro (SJF – Shortest Job First).


C

por prioridades.


D

round-robin (RR).


E

de filas multiníveis.

Analise as afirmativas a seguir sobre a técnica de paralelismo:


I. Em sistema com porta única para memória de dados e de instrução, se duas (ou mais) instruções acessam dados e/ou instruções da memória, temos um exemplo de hazard de controle no nosso pipeline.

II. Em um pipeline, quando uma instrução depende do resultado da instrução anterior que ainda não foi concluída, dizemos que temos um exemplo de hazard de dados.

III. Uma maneira de evitar um hazard estrutural é a duplicação de um recurso para permitir todas as combinações de instruções que queremos executar em um mesmo ciclo de clock.

IV. O adiantamento (Bypassing ou Forwarding) de dados é uma técnica para resolver alguns tipos de hazard de dados que consiste em utilizar o elemento de dado a partir dos buffers internos em vez de esperar que chegue nos registradores visíveis ao programador ou na memória.


Assinale


A

se somente as afirmativas I, II e IV estiverem corretas.


B

se somente as afirmativas I, III e IV estiverem corretas.


C

se somente as afirmativas II, III e IV estiverem corretas.


D

se somente as afirmativas II e III estiverem corretas.


E

se somente as afirmativas I e IV estiverem corretas.

Para melhorar o desempenho de um computador, a estratégia de pipeline vem sendo utilizada. Ela atua, dentro do computador, especificamente no(a):


A

disco rígido.


B

memória RAM.


C

placa mãe.


D

barramento.


E

CPU.

Contadores são componentes bastante versáteis para o projeto de circuitos digitais. Eles podem ser utilizados como divisor de frequência quando se deseja reduzir o relógio, ou clock, do circuito. Considerando o esquema da figura ao lado que implementa um divisor de clock com um contador para cima, ou up-counter, o valor da frequência na saída do circuito é

Imagem associada para resolução da questão


A
250 kHz.

B
200 kHz.

C
20 kHz.

D
25 kHz.

O cérebro do computador é a CPU. Ela busca instruções na memória e as executa. Sobre CPU, é correto afirmar que


A

uma CPU pode ser denominada pipeline, que é quando a CPU tem apenas uma unidade de busca de decodificação e de execução, de modo que, enquanto ela estiver executando uma instrução, nada mais é realizado.


B

o ciclo básico de execução de qualquer CPU é buscar a primeira instrução da memória, decodificá-la para determinar seus operandos e qual operação executar com estes, executá-la e então buscar, decodificar e executar as instruções subsequentes. O ciclo é repetido até que o programa pare ou finalize.


C

a CPU tem um conjunto genérico de instruções que ela pode executar. Assim, um Pentium poderá executar programas SPARC e vice-versa.


D

o ciclo básico de execução de qualquer CPU é determinar qual tipo de operação será realizada, buscar os dados na memória, interpretá-la e executá-la. O ciclo é repetido até que o programa pare ou finalize.


E

um processador superescalar é o processador que tem apenas uma unidade de busca, de decodificação e de execução, mas que executa várias funções ao mesmo tempo.

Considere as afirmações sobre os processadores de computador atualmente disponíveis no mercado.

I - A AMD é um importante fabricante de processadores. Contudo, não possui processadores para serem utilizados em servidores.

II - O processador Intel Xeon é uma opção para ser utilizado em servidores.

III - Alguns processadores podem conter mais de 15 núcleos.

Está(ão) correta(s):


A
Apenas I.

B
Apenas II.

C
Apenas III.

D
Apenas II e III.

E
I, II e III.

A maioria das CPUs apresenta dois modos de funcionamento. Em geral, o modo de funcionamento é controlado por um bit do registrador PSW (Program Status Word). Esse registrador contém o bits do código de condições, os quais são alterados pelas instruções de comparação, pelo nível de prioridade da CPU, pelo modo de execução e por vários outros bits de controle. Sobre modos de funcionamento, é correto afirmar que


A

a CPU apresenta o modo núcleo e o modo usuário. Executando o modo usuário, a CPU pode executar qualquer instrução de seu conjunto de instruções e usar cada atributo de seu hardware. É o caso típico do sistema operacional que tem acesso a todo hardware.


B

a CPU apresenta o modo núcleo e o modo usuário. Executando o modo núcleo, a CPU pode executar somente as instruções básicas. É o caso típico dos programas de usuário que tem acesso a todo hardware.


C

a CPU apresenta o modo multinúcleo e o modo núcleo. No modo multinúcleo, a CPU pode executar instruções extras e aumentar o controle sobre o hardware.


D

a CPU apresenta o modo núcleo e o modo usuário. Executando o modo núcleo, a CPU pode executar qualquer instrução de seu conjunto de instruções e usar cada atributo de seu hardware. É o caso típico do sistema operacional que tem acesso a todo hardware.


E

a CPU apresenta o modo núcleo e o modo usuário, porém o que difere é a velocidade de processamento aplicada em cada modo.

A expressão – condição de corrida (race condition) – refere-se a situações de processamento que podem levar os processos a fornecer resultados errôneos da computação. Essas condições de corrida ocorrem:


A

quando os processos rodam em máquinas cujas diferenças de velocidades de processamento forem maiores do que cos(45°) (aproximadamente 70%).


B

apenas quando 3 (três) ou mais processos estão envolvidos no acesso a variáveis compartilhadas.


C

sempre que são utilizados semáforos para proteger as seções críticas dos processos.


D

quando os processos manipulam variáveis compartilhadas de forma concorrente.


E

apenas, quando os processos estão em deadlock, causado pelo mecanismo de proteção das seções críticas.

   
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