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Após um pulso de CLR em nível baixo e mais de 30 pulsos de CLK, sem que ocorra novo pulso de CLR, o estado QBQA do circuito da figura acima, composto por dois flip-flops, dois inversores e mais uma porta lógica, ficará
alternando entre 01 e 10.
alternando entre 00 e 11.
estabilizado em 01.
estabilizado em 10.
alternando entre as 4 combinações possíveis de QBQA.