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Um circuito digital combinacional é composto por duas portas lógicas “E”, sendo a primeira conectada nas entradas A e B e a segunda conectada nas entradas A e C, e uma porta “OU” que recebe a saída das duas portas anteriores para produzir a saída S.
Assinale a alternativa que represente um circuito lógico equivalente.
Uma porta “E” conectada as entradas A e B e uma porta “OU” conectada em sua saída e na entrada A.
Uma porta “E” conectada as entradas A e C e uma porta “OU” conectada em sua saída e na entrada B.
Uma porta “E” conectada as entradas B e C e uma porta “OU” conectada em sua saída e na entrada A.
Uma porta “OU” conectada as entradas A e B e uma porta “E” conectada em sua saída e na entrada C.
Uma porta “OU” conectada as entradas B e C e uma porta “E” conectada em sua saída e na entrada A.

Da análise do circuito digital apresentado, é correto afirmar que a porta lógica por ele implementada é
CMOS AND.
CMOS OR.
CMOS XOR.
CMOS NAND.
CMOS NOR.
A figura abaixo ilustra o esquema de um circuito eletrônico digital.

A relação entrada-saída válida é:
com (A,B,C,D)=(1, 1, 1, 1 ), a saída é 1
com (A,B,C,D)=(0,0,0,0), a saída é 0
com (A,B,C,D)=(1,0,0,0), a saída é 1
com (A,B,C,D)=(0,0,0, 1), a saída é 0
A figura a seguir apresenta um circuito digital com entradas A, B, C, D e E.

Para que a saída seja igual a 1, as entradas A, B, C, D e E devem ser
1-1-1-0-0.
1-0-0-1-0.
1-0-0-0-1.
0-1-1-0-0.
0-1-1-0-1.
Analisando a figura abaixo:

Determinar qual a expressão booleana de S.
𝑆 = 𝐴. 𝐵. 𝐶;
𝑆 = 𝐴 + 𝐵 + 𝐶;
𝑆 = 𝐴 . (𝐵 + 𝐶) + (𝐴);
𝑆 = (𝐴. 𝐵) + (B.C);
Em relação à questão anterior, pode-se afirmar que o circuito eletrônico digital simplificado correspondente utilizará
duas portas AND, uma porta NOT e uma porta OR.
duas portas AND e uma porta OR.
uma porta XOR e uma porta AND.
uma porta OR e uma porta XOR.

A representação da Saída Multiplexada S é a saída

P e Q sejam nível lógico 0, após 3 segundos, o ponto S será nível lógico 1.
P e Q sejam nível lógico 1, antes de completarem os 3 segundos, o ponto S será nível lógico 1.
P e Q sejam nível lógico 0, após 3 segundos, o ponto S será nível lógico 0.
P e Q sejam nível lógico 1, após 3 segundos, o ponto S será nível lógico 1.
P seja nível lógico 0, e Q seja nível lógico 1, após 3 segundos, o ponto S será nível lógico 0.
A figura acima é utilizada em Sistemas Instrumentados de Segurança (SIS) para a determinação do Nível de Integridade de Segurança (SIL). A esse respeito, analise as afirmativas a seguir.
I - Para que ocorra a falha no sistema X, basta que ocorra falha em qualquer um dos componentes.
II - Para que ocorra a falha no sistema X, é necessário que ocorra falha nos componentes A, B e C ao mesmo tempo.
III - A figura representa um diagrama de Markov.
IV - A figura representa uma árvore de falhas.
São corretas APENAS as afirmativas
I e IV.
II e III.
II e IV.
I, III e IV.
II, III e IV.

and e nor
and e or
nand e or
nand e and
or e nand