Questões de Concurso sobre Lógica Digital

 
 
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Sobre o papel funcional da Unidade Lógica e Aritmética (ULA) e suas relações com os demais componentes do processador, analise as assertivas a seguir:


I. A ULA é responsável por controlar a sequência de execução das instruções, determinando quando buscar a próxima instrução na memória.

II. A unidade de controle oferece sinais que controlam a operação da ULA e o fluxo de dados de entrada e saída da ULA.

III. Os registradores são locais de armazenamento temporário dentro do processador, distintos da ULA.

IV. A flag de overflow é gerada pela unidade de controle com base no código de operação da instrução, antes que a ULA execute o cálculo correspondente.


Quais estão corretas?


A

Apenas I e II.


B

Apenas I e IV.


C

Apenas II e III.


D

Apenas I, III e IV.


E

Apenas II, III e IV.

Um projetista precisa implementar um circuito combinacional que converta um código BCD (Binary Coded Decimal) de 4 bits em um código de 7 segmentos para display. Para otimizar o circuito, ele decide usar o mapa de Karnaugh para cada segmento.


A principal vantagem dessa técnica em relação à implementação direta pela tabela verdade é que


A

permite identificar condições 'don't care' e eliminá-las do projeto.


B

garante que o circuito seja síncrono e sem condições de corrida.


C

minimiza o número de portas lógicas necessárias através de agrupamentos de 1s adjacentes.


D

elimina a necessidade de flip-flops no circuito.


E

converte automaticamente o circuito combinacional em sequencial.

Considere as portas lógicas a seguir, cada uma com suas entradas e saídas conforme indicado em cada alternativa.


Avalie, em cada caso, se o valor da saída C está corretamente associado à porta lógica e aos valores apresentados para as entradas A e B:


A

AND: A=0, B=0, C=1.


B

NAND: A=0, B=0, C=0.


C

NOR: A=1, B=0, C=1.


D

XNOR: A=0, B=0, C=1.


E

XOR: A=1, B=1, C=1.

Um circuito sequencial síncrono é projetado utilizando Flip-Flops tipo J-K.


Se as entradas J e K forem ambas mantidas em nível lógico ‘1’ (High), na próxima borda de clock, a saída Q


A

manterá o estado anterior (Latch).


B

irá para nível lógico '0' (Reset).


C

irá para nível lógico '1' (Set).


D

inverterá seu estado anterior (Toggle).


E

entrará em estado de alta impedância.

Um engenheiro precisa projetar um circuito combinacional com 4 variáveis de entrada (A, B, C, D) que implementa a seguinte função booleana, onde os termos são mintermos:


F(A,B,C,D) = Σm(0, 2, 5, 7, 8, 10, 13, 15) Além disso, as combinações correspondentes aos mintermos 1, 3, 9 e 11 são condições "don't care" (podem ser 0 ou 1).


Após a minimização pelo mapa de Karnaugh, utilizando as condições "don't care" para obter a expressão mais simplificada possível, a expressão booleana mínima em soma de produtos (SOP) é dada por


A

F = B'D' + BD


B

F = C+D


C

F = B


D

F = B ⊕ D (função XOR entre B e D)


E

F = B' + D

Nas aplicações de lógica digital, o dispositivo na forma de circuito que possui entradas de controle que selecionam uma única saída para várias entradas de dados é chamado de


A

decodificador.


B

comparador.


C

multiplexador.


D

deslocador.


E

somador.

Circuito lógico digital que tem 2n entradas de dados e n entradas de controle no qual essas entradas selecionam, dependendo da combinação, uma das entradas de dados, que é direcionada até a saída deste circuito. O trecho apresentado define o:


A

Divisor.


B

Subtrator.


C

Acumulador.


D

Demultiplexador.


E

Multiplexador.

Qual a única combinação de A, B e C que gera resultado verdadeiro ("1") para a expressão lógica a seguir?


Imagem associada para resolução da questão


Considere "0" como falso e "1" como verdadeiro.


A

A = 0, B = 0 e C = 0.


B

A = 0, B = 0 e C= 1.


C

A = 1, B = 0 e C = 1.


D

A = 1, B = 0 e C = 0.


E

A = 1, B = 1 e C = 1.

Considere o circuito a seguir, com entradas A, B, C e D, e saída Z, composto por 3 portas lógicas do tipo XOR:


Imagem associada para resolução da questão

Assinale a alternativa que apresenta, respectivamente, valores para as entradas A, B, C e D que resultem na saída Z=0.


A

0, 1, 0, 1


B

1, 0, 1, 1


C

1, 0, 0, 0


D

0, 0, 1, 0


E

1, 1, 1, 0

Sobre os operadores lógicos é correto afirmar:


I - E (AND) Se ambas as expressões forem verdadeiras, o resultado será́ verdadeiro.

II - OU (OR) Se uma das expressões (ou ambas) for verdadeira, então o resultado será́ verdadeiro.

III - Não (NOT) a negação de uma expressão lógica. Se ela for verdadeira, a torna falsa. E vice-versa.

IV - OU (OR) Se ambas as expressões forem verdadeiras, o resultado será falso.


A

Somente I e II estão corretos.


B

Somente II e III estão corretos.


C

Somente I, II e III estão corretos.


D

Somente I, II e IV estão corretos.


E

Todas estão corretas.

No contexto da organização de computadores, as duas representações correspondem às seguintes portas lógicas:


Imagem associada para resolução da questão


A

AND e OR


B

AND e NAND


C

OR e XOR


D

OR e NOR


E

XOR e NOT

Com base no circuito de portas lógicas ilustrado na figura a seguir, considerando que as entradas são A, B, C, D e E, e a saída final é F, identifique qual alternativa descreve CORRETAMENTE a função booleana equivalente ao circuito:


Imagem associada para resolução da questão


A

F = (A + B) . (C + (DE))


B

F = (AB) + (C . (D + E))


C

F = (A + B) + (C . (D + E))


D

F = (AB) . (C + (D + E))


E

F = (AB) + (C + (DE))

Considere as variáveis A, B e C contendo os seguintes números com as suas respectivas bases.


A = 1616

B = 1010

C = 102


O cálculo da soma de A + B + C é:


A

3410


B

308


C

1000112


D

AB16


E

3610

A álgebra booleana é utilizada para descrever os circuitos que podem ser construídos combinando portas, em que variáveis e funções podem assumir somente os valores 0 e 1. Nesse sentido, analise a tabela verdade abaixo, em que A e B são as entradas e X é o resultado:


Imagem associada para resolução da questão


Qual porta básica está representada na tabela verdade acima?


A

OR


B

NOT


C

AND


D

NAND


E

NOR

A figura abaixo ilustra os circuitos lógicos no desenvolvimento de uma memória RAM estática, em um arranjo simplificado de 2 x 3, isto é, 2 endereços de 3 bits. As entradas para o armazenamento dos 3 bits são representadas como I2, I1, I0. Também é possível visualizar uma entrada Addr para o endereçamento e duas entradas de controle CS (Chip Select) e RD (ReaD). As saídas da memória (lidas de algum endereço) são representadas por D2, D1 e D0. Outras possíveis entradas e saídas não foram representadas, pois não influenciam na análise da questão. Com base nesta memória, analise os diagramas de tempo dos sinais de entrada e determine as saídas D2, D1 e D0. Assinale a alternativa que corresponde aos valores das saídas no tempo T2, na ordem do bit mais significativo para o menos significativo, isto é: D2, D1, D0


Imagem associada para resolução da questão

Imagem associada para resolução da questão


A

1 0 0


B

0 1 0


C

0 1 1


D

0 0 0


E

1 1 1

Considere o diagrama de circuito lógico disponibilizado em Nogueira (2011, p.40) e apresentado a seguir.


Imagem associada para resolução da questão

(NOGUEIRA, Jurandy Santos. Eletrônica digital básica. Salvador: EDUFBA, 2011. Disponível em https:// repositorio.ufba.br/bitstream/ri/13988/1/ Eletronica.pdf. Acesso em: 18 jul. 2024.)

E possível afirmar que:


A

A equação lógica associada ao circuito é F = (A+B). (A+C) + A'B'.


B

A equação lógica associada ao circuito é F = (A+B” + (A+C) + (AC).


C

A simplificação da equação lógica do circuito com a aplicação do Mapa de Karnaugh produzirá F = ABC.


D

A simplificação da equação lógica do circuito com a aplicação do Mapa de Karnaugh produzirá F= ABC + ABC.


E

A função resultante equivale ao nível lógico 1.

Analise a imagem e responda.


Imagem associada para resolução da questão


Pode-se afirmar que a imagem corresponde a uma porta lógica, qual?


A

Porta AND.


B

Porta OR.


C

Porta NAND.


D

Porta XOR.


E

Porta NOT.

Analise as assertivas abaixo sobre circuitos combinacionais:


I. A diferença entre o full adder e o half adder é que o half adder não produz o sinal de carry de saída, enquanto o full adder produz.

II. O flip-flop é um tipo de circuito combinacional, já que pode ser implementado usando apenas portas lógicas NAND.

III. O somador ripple carry adder faz a soma em paralelo, usando um circuito para prever o carry do estágio anterior.


Quais estão INCORRETAS?


A

Apenas I.


B

Apenas II.


C

Apenas I e III.


D

Apenas II e III.


E

I, II e III.

Considere o esquemático abaixo, representando um circuito implementado com lógica complementar CMOS. Os dois transistores nMOS explícitos representam a rede pull-down. Supondo que a rede pull-up está implementada corretamente, qual a função lógica implementada por este circuito?


Imagem associada para resolução da questão


A

A NAND B


B

A AND B


C

A OR B


D

A NOR B


E

A XOR B

 
 
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